디지털 회로설계 - 고속 동작 덧셈기 설계
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작성일 23-01-31 15:22
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3. 목표 및 기준 설정
여기서 는 와 가 모두 1일 경우에만 1이 되는데, 이 경우 의 값에 상관없이 가 1이 된다 따라서 가 다음 stage의 carry 생성을 보장하기 때문에 를 generation function이라고 한다.
설명
CLA(Carry Lookahead Adder)는 Ripple Carry Adder에서 carry propagation에 의해 delay가 발생하는 문제가되는점 을 보완하기 위해 설계되었다.
위의 식을 에 대해 동일한 방법으로 확장하면 다음과 같은 식을 얻는다.
1. headline(제목) : 고속 동작 덧셈기 설계
CLA는 각 bit의 덧셈 연산을 수행하는 Full adder와 덧셈 과정에서 발생하는 carry만을 미리 계산하는 Carry-lookahead logic block으로 구성되어 있따 4개의 FA가 4-bit크기의 입력 A(A3A2A1A0)와 B(B3B2B1B0)의 각 자리 bit들을 더해 각각의 sum 값을 출력하고, carry lookahead logic에는 최종 carry-out인 를 출력하기 위한 값들이 입력된다 이 값들은 각각 generation function과 propagation function으로 불리며, 각 bit의 곱과 합을 나타낸다.
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VHDL을 이용한 고속 동작 덧셈기의 설계를 통해 덧셈 과정에 있어서 carry의 역할을 이해하고 carry 처리 방법에 따른 여러 가지 덧셈기 구조들을 익히며, VHDL의 코딩 방법을 익히고 시뮬레이션 툴의 사용법을 익힌다. 는 와 중 하나라도 1의 값을 가지면 1이 된다 이 때 이면 carry가 다음 stage로 전달될 수 있따 이렇게 는 carry를 전파해주는 역할을 하기 때문에 를 propagation function이라고 한다.
순서
최종 Carry 는 아래와 같이 나타낼 수 있따
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2. 목적
디지털 회로설계,고속 동작 덧셈기 설계
디지털 회로설계 - 고속 동작 덧셈기 설계
이때 (generation function) 항과 (propagation) 항을 각각 ,로 놓으면 식은 아래와 같이 정리(整理) 된다
1. 제목 : 고속 동작 덧셈기 설계 2. 목적 VHDL을 이용한 고속 동작 덧셈기의 설계를 통해 덧셈 과정에 있어서 carry의 역할을 이해하고 carry 처리 방법에 따른 여러 가지 덧셈기 구조들을 익히며, VHDL의 코딩 방법을 익히고 시뮬레이션 툴의 사용법을 익힌다.
3. 목표(goal) 및 기준 설정
다.
